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当前位置:教育论文中心首页--硕士论文--基于FPGA的新型全数字锁相环的设计与实现
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基于FPGA的新型全数字锁相环的设计与实现
 
     论文目录
 
摘要第5-6页
ABSTRACT第6-7页
第一章 绪论第11-17页
    1.1 本文研究背景第11-12页
    1.2 研究的目的和意义第12-13页
    1.3 国内外研究现状第13-15页
    1.4 本文的研究内容与论文结构第15-17页
第二章 全数字锁相环的原理第17-37页
    2.1 模拟锁相环基本结构与工作原理第17-19页
        2.1.1 锁相环的基本结构第17-18页
        2.1.2 锁相环工作原理第18-19页
    2.2 锁相环的重要概念和关键参数第19-20页
        2.2.1 锁相环的重要概念第19-20页
        2.2.2 锁相环的关键参数第20页
    2.3 全数字锁相环的基本结构和工作原理第20-32页
        2.3.1 数字鉴相器第21-25页
            2.3.1.1 异或门鉴相器第21-22页
            2.3.1.2 JK触发鉴相器第22-23页
            2.3.1.3 双触发器结构的鉴频鉴相器第23-25页
            2.3.1.4 数字鉴相器的Z域模型第25页
        2.3.2 数字环路滤波器第25-28页
            2.3.2.1 随机徘徊序列滤波器第26-27页
            2.3.2.2 具有比例积分特性的数字环路滤波器第27-28页
        2.3.3 数控振荡器第28-32页
            2.3.3.1 增减计数器式数控振荡器第28-29页
            2.3.3.2 除N计数器式数控振荡器第29-30页
            2.3.3.3 循环累加型数控振荡器第30-31页
            2.3.3.4 数控振荡器的Z域模型第31-32页
        2.3.4 分频器第32页
    2.4 基于PI控制的全数字锁相环第32-36页
        2.4.1 基于PI控制的全数字锁相环的基本结构及其数学模型第32-34页
        2.4.2 基于PI控制全数字锁相环的性能分析第34-36页
    2.5 本章小结第36-37页
第三章 新型全数字锁相环的结构研究与设计第37-61页
    3.1 新型全数字锁相环的整体结构与工作原理第37-38页
    3.2 全数字鉴相器的研究与设计第38-43页
        3.2.1 同步上升沿检测逻辑结构及工作原理第40-41页
        3.2.2 状态转移逻辑的工作原理第41-42页
        3.2.3 基于状态转移逻辑鉴相器的电路设计第42-43页
    3.3 自适应控制器研究与设计第43-52页
        3.3.1 频率测量电路的结构和工作原理第44-45页
        3.3.2 移位控制电路的设计第45-47页
        3.3.3 计数器初始置位电路的设计第47-48页
        3.3.4 自动变模电路的设计第48-50页
        3.3.5 自适应控制电路的整体电路与仿真第50-52页
    3.4 数字环路滤波器的研究与设计第52-55页
        3.4.1 调制电路第53-54页
        3.4.2 比例积分控制环节电路设计第54-55页
        3.4.3 数字环路滤波器整体电路仿真第55页
    3.5 数控振荡器的研究与设计第55-58页
        3.5.1 数控振荡器的电路设计第56-57页
        3.5.2 小数分频过程分析第57页
        3.5.3 数控振荡器的仿真第57-58页
    3.6 分频器的设计第58-59页
    3.7 本章小结第59-61页
第四章 新型全数字锁相环的整体性能分析第61-69页
    4.1 锁相环的建模第61页
    4.2 锁相环的数学模型第61-64页
        4.2.1 锁相环各模块的数学模型第61-63页
        4.2.2 系统整体的数学模型第63-64页
    4.3 锁相环性能的理论分析第64-66页
    4.4 锁相环性能的仿真分析第66-68页
    4.5 环路参数的选取第68页
    4.6 本章小结第68-69页
第五章 新型全数字锁相环的仿真验证与FPGA实现第69-84页
    5.1 全数字锁相环的整体电路实现第69页
    5.2 全数字锁相环的仿真第69-72页
        5.2.1 环路初始工作时的仿真验证第70-71页
        5.2.2 相位跟踪能力仿真验证第71页
        5.2.3 频率跟踪能力仿真验证第71-72页
    5.3 与传统ADPLL的比较第72-74页
    5.4 FPGA验证与实现第74-83页
        5.4.1 硬件实测波形第74-78页
        5.4.2 锁相环的实际应用第78-83页
    5.5 本章小结第83-84页
第六章 总结与展望第84-86页
    6.1 全文总结第84-85页
    6.2 后续工作展望第85-86页
致谢第86-87页
参考文献第87-90页
攻读硕士学位期间取得的成果第90-91页
附录第91-92页

 
 
论文编号BS3531079,这篇论文共92
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